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AnaGate UP 2.0 - Firmware Changelog

Im folgenden finden Sie Informationen über getätigte Änderungen in den einzelnen bisherigen Firmware-Versionen. 

AnaGate UP 2.0 Firmware

Versionsgeschichte
Version 2.0.811.06.2015JGo
  • neues FPGA.bit: bei Clock-Modus 3 war MOSI statt Clock-Leitung invertiert

Version 2.0.713.04.2015JGo
  • Bugfix (temporär): minimale SPI-Baudrate auf 330000 festgelegt

Version 2.0.617.12.2014JGo
  • Bugfix: DIOs nur einmal beim Start konfigurieren und auf 0 setzen statt bei jedem Verbindungsaufbau

  • Bugfix: GetGlobals schaltete Polarität ein

Version 2.0.505.08.2013JGo
  • FPGA nur einmal am Anfang programmieren statt bei jedem Verbindungsaufbau (spart ca. 1 Sekunde pro Verbindung)

Version 2.0.412.02.2013JGo
  • Compiler-Optimierungen aktiviert

  • Umstellung von CommonLib auf libAnaGate und libAnaGateExt

  • I2C: Arbitration Lost wird erkannt und abgefangen

  • SPI: performantere asymmetrische Transceive-Implementierung hinzugefügt

  • SPI: Sequence-Kommando hinzugefügt

Version 2.0.002.02.2013JGo
  • Initiale Version, based on Firmware AnaGate UP 1.3.3

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